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7 CDB42L55 BLOCK DIAGRAM
PC Control
Board Power
External 5.0 V
CODEC Power
Serial
Supply
LDO
3.3 V
LDO’s 1.8 V
2.5 V
3.3 V (VL only)
VL, VCP, VLDO, VA
MUX
1.8 V
Buck
x3
AAA Alkaline
(not included)
USB
I2C for all
applicable
devices
24 MHz
Oscillator
Circuit Break for
Stereo
PLL
External System
Input 1
S/PDIF Rx
FPGA
Clock/Data Routing
Clock dividers and PLL used
Interface
PCM
Clocks/Data
CS42L55
Stereo
Input 2
to derive all applicable Fs
S/PDIF Tx
from 24 MHz oscillator
Tri-state
I2C Clocks/
Data
Buffers
SRC (Tx)
I/O Stake Headers for Audio
Precision’s Programmable Serial
SRC (Rx)
I/O SMA Connectors
for External System
Interface
HP
Jack
Stereo HP
Output
Stereo Line
Output
Interface Adapter (PSIA)
Figure 36. Block Diagram
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